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单选题 下图器件,若LT端为低电平,输出QA-QG的状态为( )
学科：默认课程
时间：2025-11-14 10:30:36
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使用译码器设计组合逻辑电路时,将译码器的输出端经哪种门电路处理最方便A. 异或门B. 同或门C. 或非门D. 与非门
题目2单选题
以下器件数据选择控制变量中,第( )引脚的控制变量权位最高?<img src="https://tihai-oss-cloud.itihey.com/img/0c119e060324226563e40328ecd7e53a.png">A. 9B. 10C. 11D. 12
题目3单选题
以下哪类中规模集成电路适合用于设计多输出变量的逻辑函数A. 数据选择器B. BCD码译码驱动器C. 二进制译码器D. 优先编码器
题目4单选题
使用一片以下器件最多可设计( )个输入变量的逻辑函数<img src="https://tihai-oss-cloud.itihey.com/img/3e8c9acc166e6ec6bf9cf994326c393c.png">A. 2B. 3C. 4D. 5
题目5单选题
以下器件,当E1=1,E2=E3=0时,当CBA为100时,输出端( )为低电平,而其它为高电平.<img src="https://tihai-oss-cloud.itihey.com/img/89d627c55bd9a0e2f17f822be772e3a4.png">A. Y0B. Y2C. Y4D. Y6
题目6单选题
下图器件,作为数据分配器时( )端口可以作为数据输入端<img src="https://tihai-oss-cloud.itihey.com/img/89d627c55bd9a0e2f17f822be772e3a4.png">A. ABCB. E1,E2,E3C. E2或E3D. 仅E2
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下图器件,完成编码后GS和EO的输出状态为( )<img src="https://tihai-oss-cloud.itihey.com/img/eee3ad3843122a45528af058c346d751.png">A. 00B. 01C. 10D. 11
题目8单选题
下图器件,若E端输入高电平,输出端Y的状态为<img src="https://tihai-oss-cloud.itihey.com/img/b3d26bb8c4908b896f6c28f107ab488e.png">A. 0B. 1C. 10D. 01
题目9单选题
下图器件,若LT端为低电平,输出QA-QG的状态为( )<img src="https://tihai-oss-cloud.itihey.com/img/7ffbf843a773d7bd701ae9a1890c84b2.png">A. 100 0000B. 111 1111C. 000 0000D. 111 0000
题目10单选题
以下中规模集成数字器件(MSI),属于译码器的为()A. <img src="https://tihai-oss-cloud.itihey.com/img/ae7a0c6707be369e0e93815fefac0d9e.png"><br>B. <img src="https://tihai-oss-cloud.itihey.com/img/decb814b39e8363f18f59e5c09f3bb23.png"><br>C. <img src="https://tihai-oss-cloud.itihey.com/img/25327a32ce27e6d76766eb66800de9a4.png"><br>D. <img src="https://tihai-oss-cloud.itihey.com/img/7c754d40cd26a6e2bb277264b0857f45.png"><br>
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